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更新于 5月13日

fpga工程師

1.3-2萬(wàn)
  • 長(zhǎng)沙岳麓區(qū)
  • 經(jīng)驗(yàn)不限
  • 碩士
  • 全職
  • 招1人

職位描述

Verilog HDL通信/網(wǎng)絡(luò)設(shè)備
【崗位職責(zé)】 1. 主要負(fù)責(zé)公司已有FPGA軟件IP的應(yīng)用開發(fā)、及客戶交付現(xiàn)場(chǎng)的聯(lián)調(diào)工作; 同硬件、軟件工程師共同完成項(xiàng)目撰寫、項(xiàng)目計(jì)劃制定、系統(tǒng)功能定義及功能分解; 2. 負(fù)責(zé)FPGA邏輯部分的系統(tǒng)框架以及方案設(shè)計(jì); 3. 負(fù)責(zé)FPGA功能模塊的設(shè)計(jì)、仿真、實(shí)現(xiàn)、驗(yàn)證; 4. 負(fù)責(zé)完成FPGA系統(tǒng)以及外圍模塊的測(cè)試用例設(shè)計(jì); 5. 負(fù)責(zé)FPGA調(diào)試、資源優(yōu)化與時(shí)序優(yōu)化; 6. 完成領(lǐng)導(dǎo)交辦的其他工作。 【任職要求】 1. 本科或碩士畢業(yè)3年以上; 2. 熟悉FPGA開發(fā)流程,對(duì)DDR3、DDR4、PCIE、Rapdio等高速接口有深入了解; 3. 精通Verilog HDL語(yǔ)言,熟悉XILNX、復(fù)旦微等廠家的FPGA開發(fā)流程以及開發(fā)工具; 4. 熟悉使用頻譜儀、示波器、萬(wàn)用表等測(cè)試設(shè)備進(jìn)行調(diào)試和測(cè)試,能夠熟練閱讀中英文技術(shù)文檔; 5. 有良好的溝通能力,能夠清晰表述觀點(diǎn),良好的團(tuán)隊(duì)合作精神; 6. 有大型通信系統(tǒng)設(shè)計(jì)及實(shí)現(xiàn)經(jīng)驗(yàn)者優(yōu)先; 7. 能進(jìn)行DSP、FPGA算法實(shí)現(xiàn)者優(yōu)先。

工作地點(diǎn)

岳麓區(qū)長(zhǎng)沙高新開發(fā)區(qū)岳麓西大道588號(hào)芯城科技園3棟11樓

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