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更新于 6月30日

邏輯工程師fpga工程師

2-3.5萬
  • 北京海淀區(qū)
  • 3-5年
  • 本科
  • 全職
  • 招1人

職位描述

VHDLSystem Verilog通信/網(wǎng)絡(luò)設(shè)備船舶/航空/航天/火車制造
崗位職責(zé): 1.產(chǎn)品中通信相關(guān)模塊的代碼開發(fā)、仿真驗(yàn)證、系統(tǒng)測試; 2.系統(tǒng)工程的集成與維護(hù); 3.相關(guān)文檔的編寫與維護(hù); 任職要求: 1.本科及以上學(xué)歷,電子、通信相關(guān)專業(yè); 2.3年以上FPGA邏輯設(shè)計(jì)經(jīng)驗(yàn); 3.精通VHDL/Verilog語言,熟悉常用FPGA器件(Xilinx、Altera、Microsemi等),并具備芯片選型的能力; 4.熟悉通信系統(tǒng)的架構(gòu); 5.熟悉MATLAB算法仿真; 6.具備高速ADC、DAC調(diào)試經(jīng)驗(yàn); 7.具備高速接口設(shè)計(jì)、調(diào)試經(jīng)驗(yàn); 8.熟悉FPGA時序約束; 9.熟悉UVM優(yōu)先; 10.具備航天、J工領(lǐng)域FPGA邏輯設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先; 11.工作踏實(shí)認(rèn)真,具備很強(qiáng)的責(zé)任感和事業(yè)心; 12.擅于溝通與協(xié)調(diào),良好的協(xié)作精神和團(tuán)隊(duì)合作意識; 13.有良好的職業(yè)道德和職業(yè)操守;

工作地點(diǎn)

海淀區(qū)北京理工大學(xué)中關(guān)村國防科技園-6號樓17層1707室

職位發(fā)布者

馮韻臣/人事經(jīng)理

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北京眾智點(diǎn)策咨詢有限公司
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