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崗位職責(zé)：
1、完成模塊級(jí)結(jié)構(gòu)設(shè)計(jì)，RTL實(shí)現(xiàn)及相關(guān)工作；
2、協(xié)助芯片級(jí)架構(gòu)設(shè)計(jì)、RTL實(shí)現(xiàn)及相關(guān)工作；
3、參與邏輯綜合，靜態(tài)時(shí)序分析，一致性驗(yàn)證等；
4、參與RISC-V核的功能迭代升級(jí)；
5、參與常規(guī)數(shù)字外設(shè)（USART、IIC、SPI等）的功能迭代升級(jí)；
6、參與芯片的樣品調(diào)試。
任職要求：
1、深入理解ASIC設(shè)計(jì)流程，熟練掌握Verilog/System Verilog語(yǔ)言和數(shù)字邏輯設(shè)計(jì)驗(yàn)證方法；
2、熟練使用Linux環(huán)境和相關(guān)EDA工具軟件，熟悉至少一種腳本語(yǔ)言如TCL， Perl和Python等;
3、良好的溝通能力及團(tuán)隊(duì)合作精神；
4、具有SpinalHDL或Chisel等開(kāi)發(fā)經(jīng)驗(yàn)者優(yōu)先考慮；
5、有RISC-V或車(chē)規(guī)SoC架構(gòu)設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先考慮；
6、碩士以上學(xué)歷，微電子，集成電路，計(jì)算機(jī)，軟件專(zhuān)業(yè)優(yōu)先。
員工福利：
五險(xiǎn)一金、年終獎(jiǎng)金、帶薪休假、年度體檢、節(jié)日禮金、生日禮金、防暑降溫費(fèi)、加班餐、團(tuán)建活動(dòng)、彈性打卡工作制、五星工作環(huán)境